Hemuppgifter
Hemuppgifter
Hemuppgifter
You also want an ePaper? Increase the reach of your titles
YUMPU automatically turns print PDFs into web optimized ePapers that Google loves.
Lab 1 Kombinatoriska kretsar<br />
Förberedelser på grundnivå<br />
Kursnamn: ......................................................... Datum:................................................<br />
Namn: .......................................................... Personnummer:.........................................<br />
GF1<br />
Sanningstabell och booleskt uttryck<br />
Bestäm och ange logiska sambandet mellan in- och utsignal för varje grindtyp !<br />
A<br />
B<br />
&<br />
NAND<br />
UT<br />
A<br />
B<br />
&<br />
UT A<br />
B<br />
> 1<br />
AND OR<br />
UT<br />
Ange typbeteckning i CMOS 4000-serien eller 74HC-serien<br />
NAND = .................... AND = ....................... OR = .........................<br />
A B UT<br />
0 0<br />
0 1<br />
1 0<br />
1 1<br />
A B UT<br />
0 0<br />
0 1<br />
1 0<br />
1 1<br />
A B UT<br />
0 0<br />
0 1<br />
1 0<br />
1 1<br />
UT = ............................. UT = ......................... UT =.................................
GF2<br />
En kombinatorisk logikkrets<br />
Nätet nedan skall simuleras och kopplas upp för mätning (i labmoment GL2).<br />
Grindarna måste för detta var och en ges en unik beteckning ! Nätet är uppbyggt med<br />
tre AND- , två OR- samt två NAND-grindar. I GF2-förberedelseuppgiften skall ni<br />
hemma före labben införa dessa beteckningar i logikschemat på ett A4-ark.<br />
X<br />
&<br />
> 1<br />
&<br />
Y<br />
> 1<br />
F<br />
Z<br />
&<br />
&<br />
&<br />
Metodik: Benämn allmänt IC-kapslar (här med AND-, OR- respektive NANDgrindar)<br />
vid namn U och en löpande ökande numrering dvs U1,U2,U3,...etc i det fall<br />
att a) typ av kapsel ändras genom val av ny grindtyp eller b) alla grindar från<br />
given IC-kapsel använts till beskrivning av logikkretsen och nästa grind måste tas ur<br />
ny IC-kapsel (med samma grindtyp). Addera till ” U följt av nummer” för varje<br />
grind i en kapsel en bokstav för att varje grind i en given kapsel skall erhålla en<br />
unik benämning ! Exempelvis för kapslar med 4 st grindar välj, för varje ny instans<br />
av grind som tas ifrån en given kapsel, konsekutivt den bokstav av A, B,C respektive<br />
D som ”står på tur” dvs för NAND-grindarna i schemat ovan välj U1B efter att U1A<br />
valts. För in benämning av samtliga grindar (U med nummer och bokstav enligt ovan)<br />
i figuren med logikkretsen ovan. Ange även typnummer för grindarna som antas vara<br />
ur CMOS 4000-serien eller CMOS 74HC-serien.<br />
För varje ny grind som användes ur IC-kapsel skall ni numrera in- och<br />
utgångsanslutningar enligt databladets bennummer-beteckningar (Ni hittar datablad<br />
på web:en !) För var och en av de fyra alternativa 2-ingångars logikgrindarna<br />
(A,B,C,D) i en kapsel med 4 st logikgrindar (av de IC-kretsar som användes i Lab1)<br />
motsvarar A bennumren (in:1,2 och ut:3), B (in:5,6 och ut:4), C (in:8,9 och ut:10)<br />
samt D (in:12,13 och ut:11).<br />
Anm.: I labmoment GL2 vid schemainmatning med Capture (PSpice) ändrar Ni<br />
”default”-texten U1A (som kommar att visas vid placering av logikgrind i schemat) så<br />
att det schema Ni matar in med Capture för simulering (med PSpice) överrenstämmer<br />
fullständigt med det kretsnätunderlag Ni här arbetar fram för funktionen F.<br />
Anm.: En beteckningsändring i Capture (tex U1A till U1B) medför automatiskt att<br />
bennumren på logikgrinden ändras (från in:1,2 till in:5,6 respektive från ut:3 till ut:4)<br />
2
Inför grindbeteckningar och bennummer<br />
Färdigställ schemat för F=F(X,Y,Z) som visades på föregående sida för simulering och<br />
uppkoppling för mätning genom att införa grindbeteckningar och bennummer tex i<br />
schemat i figuren ovan alt. på nytt A4-ark. Använd den metodik för beteckning av<br />
grindarna som beskrevs ovan.<br />
Vid labtillfället får Ni tillgång till schemaeditorn Capture och skall då mata in Ert<br />
förberedda schema och simulera med PSpice.<br />
I laborationsmoment GL2 skall uppkopplingen av schemat ske på så sätt att simulerat<br />
schema och uppkopplat schema överrensstämmer !<br />
Ange den booleska ekvationen för F = F( X, Y, Z) för det kombinatoriska nätet !<br />
F= ..........................................................................................................<br />
Komplettera sanningstabellen nedan med värden på funktionen F !<br />
X Y Z F<br />
0 0 0<br />
0 0 1<br />
0 1 0<br />
0 1 1<br />
1 0 0<br />
1 0 1<br />
1 1 0<br />
1 1 1<br />
Försök förklara vilken logisk funktion F realiserar !<br />
__________________________________________________________________<br />
__________________________________________________________________<br />
3
GF3<br />
Den icke-minimerade respektive minimerade kretsen av NAND-NAND-typ<br />
YZ<br />
00 01 11 10<br />
X<br />
0<br />
1<br />
F<br />
Komplettera Karnaughdiagrammet ovan och ange det booleska uttrycket för<br />
funktionen F = F ( X, Y, Z ). Funktionen F beskrives av logikschemat som<br />
givits enligt GF2. Funktionen F = F ( X, Y, Z ) skall anges på minimerad SPform<br />
(summa av produktform).<br />
F = ....................................................<br />
(minimerad SP-form)<br />
Realisera den minimerade funktionen med hjälp av enbart 2-ingångars NANDgrindar.<br />
Man har enbart tillgång till insignalerna X, Y och Z.<br />
Komplementära signaler måste skapas i uppkopplingen. Komplementen kan<br />
skapas med NAND-grindar genom att koppla ihop de två ingångarna.<br />
Rita logik-diagrammet för den minimerade funktionen och välj grindar ur<br />
kapslarna. Numrera samtliga grindars in- och utgångar enligt datablad, som<br />
underlag för uppkoppling av det minimerade nätet.<br />
För in numreringen och rita lösningen i ramen nedan !<br />
4
GF4<br />
Den icke-minimerade respektive minimerade kretsen av NOR-NOR-typ<br />
YZ<br />
00 01 11 10<br />
X<br />
0<br />
1<br />
F<br />
Komplettera Karnaughdiagrammet ovan och ange det booleska uttrycket för<br />
funktionen F = F ( X, Y, Z ) vars uppförande beskrivs av logikschemat som givits<br />
enligt förberedelseuppgift GF2. Funktionen F = F ( X, Y, Z ) skall anges på<br />
minimerad PS-form (produkter av summaform).<br />
F = .................................................... (minimerad PS-form)<br />
Realisera den minimerade funktionen med hjälp av enbart 2-ingångars NOR-grindar.<br />
Man har enbart tillgång till insignalerna X, Y och Z . Komplementära signaler måste<br />
skapas i uppkopplingen. Komplementen kan skapas med NOR-grindar genom att<br />
koppla ihop de två ingångarna<br />
Rita logikdiagrammet för den minimerade funktionen och välj grindar ur kapslarna<br />
samt numrera samtliga in- och utgångar enligt datablad som underlag för uppkoppling<br />
av det minimerade nätet. För in numreringen och rita lösningen i ramen nedan !<br />
5
GF5<br />
Heladderare samt adderare/subtraherare<br />
Adderaren 74HC283 är uppbyggd av fyra 1-bits heladderare.<br />
Markera bredvid kretsarnas in- och utgångar i figuren tillhörande pinnummer på ICkapselns<br />
stift enligt datablad. Glöm ej matningsspänningarnas pinnummer !<br />
A4 B4<br />
A3 B3<br />
A2 B2<br />
A1 B1<br />
heladderare<br />
(1-bit)<br />
Cout<br />
S4<br />
Cin4<br />
4-bitars binär heladderare<br />
(74HC283/Ph)<br />
S3<br />
S2<br />
S1<br />
Cin<br />
Nedan visas sanningstabellen för 1-bits heladderaren med insignalerna A4, B4, Cin4 och<br />
utsignalerna S4 (summa bit) och Cout = Cout4 (carryout bit). Komplettera<br />
sanningstabellen med värden för parallelladderarens mest signifikanta summabit S4 samt<br />
dess carrybit Cout4.<br />
A4 B4 Cin4 S4 Cout<br />
0 0 0<br />
0 0 1<br />
0 1 0<br />
0 1 1<br />
1 0 0<br />
1 0 1<br />
1 1 0<br />
1 1 1<br />
Ange de booleska uttrycken för summan S4 och minnesbiten Cout (=Cout4)<br />
S4 = .............................................. Cout = ......................................................<br />
6
Addition för beräkning av summan A + B<br />
Summan S = A + B skall beräknas för de positiva talen A och B.<br />
Antag att talen A och B är binärkodade 4-bitars tal :<br />
A = (A 4 , A 3 , A 2 , A 1 ) 2 och B = (B 4 , B 3 , B 2 , B 1 ) 2<br />
,där A 1 och B 1 är minst signifikanta bitar<br />
Skriv talen A = (2) 10 och B = (5) 10 på binär form :<br />
A = (......., ......., ......., .......) 2<br />
B = (......., ......., ......, .......) 2<br />
A4 B4<br />
A3 B3<br />
A2 B2<br />
A1 B1<br />
Cout<br />
4-bitars binär heladderare<br />
(74HC283/Ph)<br />
Cin<br />
S4<br />
S3<br />
S2<br />
S1<br />
Skriv summan S = ( S 4 , S 3 , S 2 , S 1 ) 2 på binär respektive på decimal form !<br />
S = (......., ......., ......., .......) 2<br />
S = (......................) 10<br />
För in signalvärden i figuren ovan!<br />
Vilket värde skall Cin ha? Svar: Cin = .....................<br />
7
Användning av adderaren vid beräkning av subtraktionen A – B<br />
A4 B4<br />
A3 B3<br />
A2 B2<br />
A1 B1<br />
Cout<br />
4-bitars binär heladderare<br />
(74HC283/Ph)<br />
Cin<br />
S4<br />
S3<br />
S2<br />
S1<br />
Subtraktionen S = A - B skall beräknas för de positiva talen A = (2) 10 och B = (5) 10 .<br />
Subtraktionen S = A - B kan beräknas som en addition av det positiva talet A och ett<br />
negativt tal (-B): S = A + (- B).<br />
Det negativa talet (-B) representerar vi med B:s 2-komplement, vilket skrives som 2 B.<br />
Då gäller att det negativa talet (-B) = 2 B<br />
Subtraktionen S = A – B = A + (-B) kan då beräknas som en addition S = A + 2 B.<br />
Antag att talen A, B och S är binärkodade som ovan:<br />
A = (A 4 , A 3 , A 2 , A 1 ), B = (B 4 , B 3 , B 2 , B 1 )<br />
och S = (S 4 , S 3 , S 2 , S 1 ),<br />
där A 1 , B 1 och S 1 är de minst signifikanta bitarna<br />
och de mest signifikanta bitarna A 4 , B 4 och S 4 är teckenbitar.<br />
Skriv talen A , B , 2 B , och S på binär form !<br />
A = (...., ...., ...., ....) 2 ; B = (...., ...., ...., ....) 2 ;<br />
2 B = (...., ...., ...., ....) 2 ;<br />
S = A + 2 B = (...., ...., ...., ....) 2 + (...., ...., ...., ....) 2 = (S 4 , S 3 , S 2 , S 1 ) = (...., ...., ....,....) 2<br />
S 4 = (.......) 2 ; (teckenbit)<br />
Hur skall den genom addition beräknade summan A + 2 B ovan (S 4 , S 3 , S 2 , S 1 )<br />
behandlas för tolkning av resultatet med avseende på teckenbiten S 4 :s värde ?<br />
Svar: ............................................................................................................................<br />
Hur fås resultatet av subtraktionen fram och vad blir resultatet av subtraktionen ?<br />
Svar: .......................................................................................................................<br />
8
Komplettera kopplingsschemat för adderaren med fyra inverterare (74HC4049) så att<br />
den ovan behandlade subtraktionen utförs.<br />
OBS! Vid uppkoppling för subtraktion och mätning ( Se mätmoment i avsnittet GL5)<br />
behöver Ni inte koppla in inverterarna. Här däremot skall ni visa hur man löser<br />
problemet med inverterare inkopplade.<br />
Cout<br />
4-bitars binär heladderare<br />
(74HC283/Ph)<br />
Cin<br />
S4<br />
S3<br />
S2<br />
S1<br />
Markera vid kretsarnas in- och utgångar i figuren tillhörande pinnummer på ICkapslarnas<br />
ben enligt datablad. Ange även kapselbenämning.<br />
Glöm ej matningsspänningarnas pinnummer.<br />
Ange i schemat logiska nivåer (0 eller 1) för de binära talen A= (A4, A3, A2, A1),<br />
B = (B4, B3, B2, B1) och inverterarnas binära utsignal I =( I4, I3, I2 och I1), som<br />
kopplats in på lämpligt sätt till heladderaren, samt signalen Cin så att subtraktionen<br />
A - B utförs som en addition A + (-B) med det negativa talet (-B) skrivet på<br />
2-komplementär form. Beräkna utsignalerna S4, S3, S2 och S1 !<br />
Resultat av additionen A + 2 B på 2-komplementär form :<br />
S = A + 2 B = (...., ...., ...., ....) 2 + (...., ...., ...., ....) 2 = (S 4 , S 3 , S 2 , S 1 ) = (...., ...., ....,....) 2<br />
S 4 = (.......) 2 ; (teckenbit)<br />
Eftersom reultatet angives på 2-komplementär form måste resultatet omvandlas för att<br />
erhålla rätt resultat. Hur skall omvandlingen att ske ?<br />
Svar: ..................................................................................................................<br />
....................................................................................................................<br />
Ange resultatet som ett positivt eller negativt tal uttryckt i basen 10 ! Svar: ................<br />
9
Förberedelser på högre nivå<br />
HF1<br />
Konstruktion av Magic Month Reminder med hjälp av ”don’t care”<br />
Konstruera ett minimalt grindnät som visar månader med 30 dagar !<br />
För att vid lab-tillfället testa din uppkoppling får du vid realiseringen använda<br />
kretsar av typen inverterare, 2-ingångars NAND-grindar och 3-ingångars NANDgrindar.<br />
Indata: Fyra bitar D, C, B och A, som anger månaden binärt (0001 för januari,<br />
0010 för februari 0011 för mars, etc.).<br />
Utdata: En bit F som indikerar månad med 30 dagar medelst en lysdiod.<br />
Du skall utnyttja möjligheten att använda ”don’t care” !<br />
Ledning: Hur många kombinationer behövs för att definiera månaderna ?<br />
Använd programmet OrCAD 9.2 Lite (med operativsystem XP). Rita schema<br />
med schemaeditorn Capture och simulera med PSpice.<br />
Krav: Hela lösningen fram till schema med unika namn för IC-kapslarna och<br />
bennumrering (för alla grindar) skall kunna redovisas i början av<br />
laborationstillfället !<br />
10