ModulaÃ§Ã£o Vetorial Aplicada ao Retificador TrifÃ¡sico PWM - Ivo Barbi

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199Para o retificador Δ_1, os sinais de comando dos interruptores de cada braçoconectados às fases A, B e C são mostrados na Fig. 8-5 e os sinais de razão cíclica geradospelo DSP e lidos nos conversores D/A são apresentados na Fig. 8-6.Neste caso, o formato e a evolução dos sinais de comando e de razão cíclicacorrespondem <strong>ao</strong>s apresentados no capítulo 4.a) Sub-setor 2C. b) Sub-setor 1C.c) Sub-setor 1A. d) Sub-setor 6A.e) Sub-setor 6B. f) Sub-setor 5B.Fig. 8-5 – Sinais de comando em cada um dos sub-setores para o retificador Δ_1.
200Fig. 8-6 – Razões cíclicas para o retificador Δ_1.8.3.1. Procedimento de PartidaOs principais sinais relacionados com o transitório de partida do retificador para atensão de entrada em 380 V e saída em 700 V são mostrados na Fig. 8-7.A evolução dos sinais de razão cíclica durante o transitório de partida (Dd SOFT eDq SOFT ) é apresentada na Fig. 8-7 (a) e o comportamento da tensão de saída e das correntesde entrada é verificado na Fig. 8-7 (b).Verifica-se a concordância dos sinais com aqueles descritos no procedimento departida detalhado na secção 7.5.5, onde se têm a limitação dos picos de corrente de entradapelos resistores de pré-carga e o aumento gradativo da tensão de saída até que seja atingidoo seu valor de referência nominal.iB( t )DdSOFT() tDA( t)iBvO( t )( t)DqSOFT( t )iC( t )a) Ddsoft e Dqsoft. b) Tensão de saída.Fig. 8-7 – Transitório de Partida.
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260GNDVsincA10k56nR54C31+15VR473.3k
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262Barra de PinosBarra de Pinos1Bar
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264int10: B int10int11: B int11int1
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266LDP #DP_EVBSPLK #0000h, T3CONSPL
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268SACL IDrefSATMAR *,AR4LDP #IDref
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270; Dqlinha (total)LDP #DqlinhaPAD
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272LDP #KD_1LT KD_1MPY DalfaSPACLDP
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274CLRC SXMCLRC OVM; testa Inibe pa
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276REFERÊNCIAS BIBLIOGRÁFICAS[1]
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278[21] AREDES, M.; Active Power Li
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280[44] BOTTERÓN, F.; Análise, Pr
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282[67] BORGONOVO, Deivis; Análise
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