ModulaÃ§Ã£o Vetorial Aplicada ao Retificador TrifÃ¡sico PWM - Ivo Barbi

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177A Fig. 7-12 mostra o diagrama completo do sistema simulado.RepeatingSequenceS/HSampleand Hold5ConvertConversion4PulseGenerator5Kdesacopl1-K-Sum3DdDqDalfaDbetaTransformaçãoDQ Inversa Q15DaDalfaDbDbetaDcModulaçãoVetorial Q15U1 D1U2 D2U3 D3PWMTrifásicoDA IAIBDBICVoDCRetifcador PWM YErroVIDrefIDref IDref f iltErroId DdlinhaSum5Compensador deTensão0ConstantPulseGenerator6ConvertConversion5Filtro deReferênciaSum1Sum2ErroIq DqlinhaCompensador deCorrenteKdesacopl-K-Compensador deCorrenteSum4X1XdX2XqX3Transformaçãode Park Q15ConvertConversion2ConvertConversion1ConvertConversion3S/HSampleand Hold1S/HSampleand Hold2-K-KAD2PulseGenerator1-K-KAD1PulseGenerator2-K-KI131420s+31420Filtro anti aliasing1-K-KI231420s+31420Filtro anti aliasing2S/HSampleand Hold6ConvertConversion6S/HSampleand Hold431420s+31420Filtro anti aliasing4S/HSampleand Hold3PulseGenerator3PulseGenerator4KAD4-K--K-KAD3KI331420s+31420Filtro anti aliasing3KV1-K--K-Fig. 7-12 - Diagrama completo utilizado na simulação.Na Fig. 7-13 é mostrado o estágio de potência do retificador unidirecional utilizadonestas simulações.m2221g1g1g1g2Ideal Switch3Ideal SwitchmIdeal Switch1mIdeal Switch2mStepDiode17Parallel RLC Branch2Parallel RLC Branch+v 4-Voltage MeasurementVoParallel RLC Branch1mmakaakkaakkakDiode7mmDiode5mDiode8mDiode4mDiode6makakDiode2maamkkmamkDiode16Diode18Diode3Diode9mmakakakDiode13mDiode14mm++i-+i-i-aakkakakDiode11DA2DBDiode113DCmDiode10Diode12Diode151 IA2 IB3 ICCurrent Measurement2Current Measurement1Current MeasurementLALA1LA2Va2Va1Va3Fig. 7-13 – Estágio de potência.
178A Fig. 7-14 mostra a lógica utilizada para a implementação da modulação vetorial,dando como exemplo, a determinação da razão cíclica da fase A, a partir dos resultados datransformação inversa.2 Dbeta 1 DalfaGain11Gain1Sum3Sum12.5ConvertkConversion5Gain5-K--K-Gain6.5ConvertSum4Sum2Convertk2Conversion1Gain7Setor1Conversion4ConvertMultiply1.5k1ConvertConversion7-K--K-Gain8Setor2Conversion6ConvertMultiply2Gain2.5k3.5k4ConvertConversion2ConvertConversion8Sum7Gain11-K-Gain12-K-Sum6Sum5Sum8Setor3Setor4Setor5Conversion21ConvertConversion22ConvertConversion23ConvertMultiply3Multiply4Multiply511Da.5k5ConvertConversion3Gain13-K-Gain14Setor6Conversion24Multiply6Sum-K-Fig. 7-14 – Lógica para modulação vetorial.A lógica utilizada para simulação da transformação direta aplicada ao retificadorunidirecional é apresentada na Fig. 7-15.PulseGenerator5S/HConvertMultiply1X1cossenocossenop120S/HSampleand Hold2Sampleand Hold1Conversion2ConvertConversion1Multiply1Sum-K-Gain1Xd2X2S/HConvertMultiply2cossenom120Sampleand Hold3Conversion33X3senoS/HS/HSampleand Hold4ConvertConversion5ConvertMultiply3Multiply4Sum1-K-Gain12Xqsenop120Sampleand Hold6Conversion6senom120S/HSampleand Hold5ConvertConversion4Multiply5Fig. 7-15 – Transformação direta.
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238.ends qualyuniy20k_S36.subckt qu
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240R97C497.7kV15n646nVo5/400R92 TL0
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242E_SUM26 $N_0009 0 VALUE{V($N_001
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244ANEXO D. Dimensionamento do Est
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248⎧ vA(t) + vB(t) + vC(t) = 0⎪
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250P 0,613⋅V −2⋅η⋅VI = ⋅
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252ππ⎧⎫6 61 ⎪⎪IS = ⋅⎨
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254ID3456MEDdiodos D I3456 .0⎧⎫
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256ANEXO E. Esquemas Elétricos das
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258C7100pF1110U2ALF347324111+-V+V-O
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260GNDVsincA10k56nR54C31+15VR473.3k
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262Barra de PinosBarra de Pinos1Bar
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264int10: B int10int11: B int11int1
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266LDP #DP_EVBSPLK #0000h, T3CONSPL
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268SACL IDrefSATMAR *,AR4LDP #IDref
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270; Dqlinha (total)LDP #DqlinhaPAD
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272LDP #KD_1LT KD_1MPY DalfaSPACLDP
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274CLRC SXMCLRC OVM; testa Inibe pa
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276REFERÊNCIAS BIBLIOGRÁFICAS[1]
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278[21] AREDES, M.; Active Power Li
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280[44] BOTTERÓN, F.; Análise, Pr
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282[67] BORGONOVO, Deivis; Análise
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