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Prof. Marcelo Andra<strong>de</strong> da Costa VieiraProfa. LuízaCodáProfa. Maria Stela Veludo <strong>de</strong> PaivaSEL 415INTROD. À ORGANIZAÇÃODE COMPUTADORES
Totem PoleColetor /Dreno em AbertoTristate
Estágio da Saída <strong>de</strong> <strong>Portas</strong> LógicasLSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais• Há três tipos <strong>de</strong> circuito <strong>de</strong> saída usados em portaslógicas:• totem pole• <strong>coletor</strong> <strong>aberto</strong>• 3- state
Funcionamento <strong>de</strong> uma portalógicaSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Porta NAND TTL ( (totem pole)SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Porta NAND TTL – Saídaem “0”SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Porta NAND TTL – Saídaem “1”SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Ligação<strong>de</strong> <strong>Portas</strong> lógicasTTLSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais• Necessida<strong>de</strong> <strong>de</strong> compartilhamento<strong>de</strong> duto (fio)• Uma saída em alto e outraem baixo conectadas juntas PROBLEMABA1274003...ONOff...+5V +5VQ 1AQ 2AXQ 1BQ 2BOff...ON...CD123Porta A-saídaPorta B– saída7400
Ligação<strong>de</strong> <strong>Portas</strong> lógicasTTLSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais• Se a saída <strong>de</strong> A = 1 (alto) Q 1Aconduz e Q 2A cortado• Se a saída <strong>de</strong> B = 0 (baixo) Q 1Bcortado e Q 2B conduzQ 2B drenará uma corrente muitoalta (representará u maresistência muito baixacomparada a Q 1A )...ONOff...+5V +5VQ 1AQ 2AXQ 1BQ 2BOff...ON...DANOSPorta A:estágio <strong>de</strong>saídaPorta B:estágio <strong>de</strong>saídaSOLUÇÃO remover o transistor ativo dos circ. saída (Q 1 ) saídaem <strong>coletor</strong> (dreno) <strong>aberto</strong>
CIRCUITOS DE SAÍDA EMCOLETOR (DRENO) ABERTOSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
CIRCUITOS DE SAÍDA EMCOLETOR (DRENO) ABERTO+5V +5VSEL/EESC-USP Grupo <strong>de</strong> Sistemas DigitaisCIRCUITOResistor <strong>de</strong> pull upQSAÍDA+5VR P• Com saída em 0 (baixo) Qconduzindo...ONOff...• Com saída em 1 (alto) Qcortado CIRCUITO ABERTO necessida<strong>de</strong> <strong>de</strong> R pQ 1AQ 2APorta AXQ 1BQ 2BPorta BOff...ON...
CIRCUITOS DE SAÍDA EMCOLETOR (DRENO) ABERTOSEL/EESC-USP Grupo <strong>de</strong> Sistemas DigitaisCIRCUITOResistor <strong>de</strong> pull upQSAÍDA+5VR P• Com saída em 1 (alto) Qcortado CIRCUITO ABERTO necessida<strong>de</strong> <strong>de</strong> R p Se Q conduz (“ligado”) S = 0 Se Q cortado (“<strong>aberto</strong>”) S = 1** sem R p V o seriain<strong>de</strong>terminada (flutuante)• Com saída em 0 (baixo) Qconduzindo
SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais<strong>Portas</strong> <strong>de</strong> <strong>coletor</strong> <strong>aberto</strong>: são portas cujo estágio <strong>de</strong> saída tem somente um transistor.Como o <strong>coletor</strong> do transistor está <strong>aberto</strong> a porta funcionarácorretamente somente quando for conectado um resistor“elevador” externo, Rext.Essas portas po<strong>de</strong>m ter suas saídas conectadas juntas e ligadas aum resistor comum, cujo valor <strong>de</strong>pen<strong>de</strong> do número <strong>de</strong> saídasBACIRCUITOS DE SAÍDA EM COLETOR(DRENO) ABERTOestágio<strong>de</strong>entradaR?Q?NPNRext +5Vfig.a.2.1 - Estágio <strong>de</strong> saída <strong>de</strong> uma porta<strong>coletor</strong> <strong>aberto</strong>YBACD2323U?A7401U?A7401Y11Y2 1R?Rext +5Vfig.a.2.2 - <strong>Portas</strong> NAND, 7401, saída <strong>coletor</strong><strong>aberto</strong>, com saídas Y1 eY2 conectadas
CIRCUITOS DE SAÍDA EMCOLETOR (DRENO) ABERTO+5VConexão wired ANDSEL/EESC-USP Grupo <strong>de</strong> Sistemas DigitaisABC10 KS = A B C Se uma ou mais saídas 0 S = 0 (o zero “vence”) S = 1 apenas se todas as saídas = 1 Mais lento e maior dissipação <strong>de</strong> potência do que oTTL normal
CIRCUITOS DE SAÍDA EMCOLETOR (DRENO) ABERTOSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais• EX. DE APLICAÇÕES:Drivers7407 – 30V/40mA
Saídas3-State• Necessida<strong>de</strong> também <strong>de</strong> compartilhamento <strong>de</strong> dutoSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais• Característica S em • AltoOE é a entrada <strong>de</strong>controle do 3-state• Baixo• Alta impedânciaPorta Inversora com saída 3-state
Saídas3-StateEstágio <strong>de</strong> saída <strong>de</strong> uma porta 3-state+5VSEL/EESC-USP Grupo <strong>de</strong> Sistemas DigitaisAestágio<strong>de</strong>entradaU?A1 27404En.fig. a.3.1 - Estágio <strong>de</strong> saída <strong>de</strong> uma porta inversora,representado por chaves1212U?A7408U?A740833Q1S?Q2S?YAU?AS?1 2En.AEn.U?A1 27404YYSe En = “0”, Q1 e Q2 permanecem <strong>aberto</strong>s e a saída Y fica emalta impedância, estado esse representado pela letra Z .
Saídas3-StateSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais• Saídas <strong>de</strong> CIs com 3-state po<strong>de</strong>m ser conectadasjuntas sem causar problemas à velocida<strong>de</strong> <strong>de</strong>chaveamento (mesma velocida<strong>de</strong> dos TTL comuns)• Quando várias portas 3-state são ligadas juntas,apenas uma <strong>de</strong>ve ser habilitada por vez! (po<strong>de</strong>danificar o dispositivo)
Buffers tristate não inversores10SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
- Tristate usados para conectar algums sinais a umbarramento comum;- Condiçõespara transmitir o sinal B para o barramento.SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Conflito no barramento se não for utilizada portastristateSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
SímbolotristateSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Resistor <strong>de</strong> Pull-up up <strong>de</strong> entrada10 KWSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais• Permite a ligação <strong>de</strong> teclados,botões, etc..• Não significa entrada emdreno <strong>aberto</strong>!• Alguns microcontroladorestêm pull-ups internos paraeste fim.A 0
Barramento <strong>de</strong> dados/en<strong>de</strong>reen<strong>de</strong>reçosduto D0 – D7SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Registrador TristateSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Registrador TristateSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Registrador TristateSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
Barramento bidirecionalSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais
<strong>Portas</strong> <strong>de</strong> três estados (“3-state(state”)SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais/1G1A2A3A4AU?A1 2c. Exemplo <strong>de</strong> CircuitosU?A1 2U?A1 2U?A1 2U?A1 2/1G Yi0 Ai1 Z1Y2Y3Y4YA1A2A8/DIR1 2 {ID}1/2 74LS244 74LS2451322U?AU?AU?A1 2U?A2U?A111 2U?A2U?A74081132U?A7408B1B2B8/G/G /DIR operação0 0 Bi para Ai0 1 Ai para Bi1 x ZD1D2D8GOCff dDCK{Value}ff dDCK{Value}ff dDCK{Value}QQQU?A1 2U?A1 2U?A1 2U?A1 274LS373Para G= “1’OC Qi0 Q dos FF1 ZQ0Q1Q8
Exemplo <strong>de</strong> AplicaçãoMICROPROCESSADOR168SEL/EESC-USP Grupo <strong>de</strong> Sistemas DigitaisA0-A15D0-D7/RD/WR/RD/WR824/WR/CS14OULógica<strong>de</strong>seleçãoInterfaceParalela<strong>de</strong> Saída(latch)4/CS3/CS2/CS1CHAVESLEDS/RD/CS3CHAVES/RDOUOU44 4InterfaceParalela<strong>de</strong>Entrada1(3-statestate)InterfaceParalela<strong>de</strong>Entrada2(3-statestate)4
SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais/WR/RDD0-D7A0-A15uP8{Value}ff d{Value}QDCK+5V +5VD2D3D4D54D1D2D3D4D3D4D5D64+5V/RD/RD+5VU?74ALS373D03D14D27D38D413D514D617D718OC1G11Q02Q15Q26Q39Q412Q515Q616Q719U?74ALS373D03D14D27D38D413D514D617D718OC1G11Q02Q15Q26Q39Q412Q515Q616Q719U?74LS2441A121A241A361A482A1112A2132A3152A4171G12G191Y1181Y2161Y3141Y4122Y192Y272Y352Y43U?A1 2R?D?D?D? D?U?7442A15B14C13D120112233445566779810911U?A 7402231U?A7432123U?A7432123DCBAExemplo <strong>de</strong> AplicaExemplo <strong>de</strong> Aplicaçãoão/RD/WRMicrop./G1/G2
Exemplo <strong>de</strong> AplicaçãoComo o microprocessador lê <strong>de</strong> um conjunto <strong>de</strong> chaves:SEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais• o microprocessador gera um en<strong>de</strong>reço que seleciona uma dasinterfaces que contem o conjunto <strong>de</strong> chaves do qual se quer ler;• O microprocessador gera o sinal <strong>de</strong> leitura /RD;• O sinal <strong>de</strong> seleção /CS mais o sinal <strong>de</strong> leitura atuam na entrada<strong>de</strong> controle da interface <strong>de</strong> forma a habilitar a passagem dosvalores das chaves daquele conjunto, para as saídas Qi, eportanto para o duto <strong>de</strong> dados.• O microprocessador lê essa informação no final do sinal <strong>de</strong>leitura e guarda-a internamente num dos registradores internos
Exemplo <strong>de</strong> AplicaçãoAlgoritmo para ler da Chaves e mostrar nos ledsSEL/EESC-USP Grupo <strong>de</strong> Sistemas DigitaisDuto <strong>de</strong> dados : D7 D6 D5 D4 D3 D2 D1 D0Chaves 2ledsChaves 1A: acumulador, que é um registrador <strong>de</strong> 8 bitsAlgoritmo para ler das chaves e mostrar valor nos leds:1. lê chaves 1 e guarda em A2. rotaciona A uma vez à esquerda3. grava no circuito dos leds4. chama rotina <strong>de</strong> espera5. lê chaves 2 e guarda em A2. rotaciona A uma vez à direita3. grava no circuito dos leds
Exemplo <strong>de</strong> AplicaçãoDetermine a faixa <strong>de</strong> en<strong>de</strong>reço que seleciona cada interfaceSEL/EESC-USP Grupo <strong>de</strong> Sistemas DigitaisA15 A14 A13 A12 A11 A10 A9 A8 A7A6 A5 A4 A3 A2 A1 A00 1 0 1 X X X X X X X X X X X X - LEDS0 1 1 0 X X X X X X X X X X X X - Chaves10 1 1 1 X X X X X X X X X X X X - Chaves2Em Hexa<strong>de</strong>cimal:LEDS: 5000H a 5FFFHChaves1: 6000H a 6FFFHChaves2: 7000H a 7FFFHObs: X representa irrelevante.
Conectando chaves e leds numaporta lógicalSEL/EESC-USP Grupo <strong>de</strong> Sistemas DigitaisChaves sãousadas paraaplicar níveislógicos( 1 ou 0)nas entradas+ 5 V+ 5 VChave aberta: aplica nível 1 na entradaR??R?D?+5VLeds sãousados paravisualizarníveis lógicos<strong>de</strong> saídas
FIMSEL/EESC-USP Grupo <strong>de</strong> Sistemas Digitais