universidade federal de santa catarina programa de póe-graduação ...
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94<br />
A P É N D I C E<br />
C<br />
J<br />
DIAGRAHA ESQUEHÃTICO DA PLACA DE TESTES<br />
O diagrama esquemático apresentado a seguir presta-se a realização <strong>de</strong> uma<br />
placa <strong>de</strong> testes para os agrupamentos <strong>de</strong> células apresentados na Fig. 4.5. Para<br />
cada agrupamento será necessário realizar uma <strong>de</strong>terminada bateria <strong>de</strong> testes e<br />
cada agrupamento tem sua especifica configuração <strong>de</strong> pinos <strong>de</strong> entrada e saida.<br />
Portanto, para testar a funcionalida<strong>de</strong> <strong>de</strong> cada agrupamento <strong>de</strong> células<br />
implementado em um PGA é necessário que se carregue o <strong>programa</strong> <strong>de</strong> configuração<br />
em uma memória EPROM do tipo 2764, e conecte-se os pinos <strong>de</strong> entrada e saída a<br />
"LEDs" e “dip-switches" conforme a necessida<strong>de</strong> da configuração a ser testada.<br />
Esta. placa foi implementada. em "wire-wrap" e os testes necessários' foram<br />
realizados, confirmando a funcionalida<strong>de</strong> <strong>de</strong> todos os grupos <strong>de</strong> células<br />
implementados em circuitos PGA.<br />
Nestes testes foram verificados se os agrupamentos <strong>de</strong> células operavam<br />
corretamente. Esta verificação foi realizada através da modificação das<br />
entradas do PGA, o qual estava configurado para o agrupamento das células em<br />
teste, através das chaves "dip-switches" conectadas às entradas. As saidas do<br />
PGA, em verificação, são conectadas a "LEDs" para a verificação da resposta em<br />
função das entradas. Desta forma, todos os agrupamentos foram testados<br />
utilizando-se esta placa <strong>de</strong> testes.