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Dynamic Voltage Scaling Dissertação para obtenção do Grau de ...

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4. Demonstra<strong>do</strong>r FPGA<br />

4.1 Introdução<br />

Com o objectivo <strong>de</strong> <strong>de</strong>monstrar o potencial <strong>do</strong> Sensor Global apresenta<strong>do</strong> nesta dissertação, foi<br />

<strong>de</strong>senvolvida uma plataforma <strong>de</strong> <strong>de</strong>monstração utilizan<strong>do</strong> uma FPGA <strong>para</strong> implementação <strong>do</strong> sensor<br />

e <strong>de</strong> um circuito digital complexo <strong>para</strong> simular a carga correspon<strong>de</strong>nte a um processa<strong>do</strong>r comum. A<br />

opção <strong>de</strong> utilizar uma FPGA pren<strong>de</strong>-se com o facto <strong>de</strong> ser um meio <strong>de</strong> <strong>de</strong>senvolvimento<br />

extremamente rápi<strong>do</strong> <strong>para</strong> obter resulta<strong>do</strong>s experimentais e ser um meio frequentemente usa<strong>do</strong> na<br />

emulação <strong>de</strong> soluções que se preten<strong>de</strong>m implementar em ASICs. Apesar <strong>do</strong> teste ao sensor ser feito<br />

recorren<strong>do</strong> a um FPGA, o objectivo é po<strong>de</strong>r <strong>de</strong>monstrar o seu funcionamento em SoC. Por esta<br />

razão, gran<strong>de</strong> parte <strong>do</strong> código VHDL implementa<strong>do</strong> foi <strong>de</strong>scrito ao nível da porta lógica ao invés <strong>do</strong><br />

respectivo comportamento. Este nível <strong>de</strong> <strong>de</strong>talhe permite realizar optimizações importantes <strong>para</strong> o<br />

<strong>de</strong>sempenho <strong>do</strong> sensor, aproximan<strong>do</strong> esta implementação em FPGA da implementação em silício no<br />

SoC.<br />

4.2 Arquitectura<br />

Para po<strong>de</strong>r implementar um sistema <strong>de</strong> ajuste automático que consiga <strong>de</strong> forma in<strong>de</strong>pen<strong>de</strong>nte<br />

controlar a sua própria tensão <strong>de</strong> alimentação, é necessário recorrer a mais alguns dispositivos extra<br />

que suportem as instruções <strong>de</strong> controlo geradas na FPGA. Esta situação implica fazer algumas<br />

alterações físicas na placa <strong>de</strong> circuito impresso da FPGA original [15] <strong>de</strong> mo<strong>do</strong> a permitir a utilização<br />

<strong>de</strong> uma fonte <strong>de</strong> tensão externa na alimentação <strong>do</strong>s 1,2V fornecida ao chip da Xilinx ® . O objectivo é<br />

criar uma arquitectura fechada on<strong>de</strong> o controla<strong>do</strong>r <strong>do</strong> sensor consegue configurar a tensão <strong>de</strong><br />

alimentação <strong>de</strong>sejada (Figura 4.1).<br />

Figura 4.1 – Arquitectura <strong>de</strong> funcionamento <strong>do</strong> <strong>de</strong>monstra<strong>do</strong>r<br />

Neste caso, o módulo que disponibiliza a alimentação externa é um conversor DCDC com<br />

tensão <strong>de</strong> saída programável através <strong>de</strong> protocolo SPI. Para implementar o circuito digital cuja<br />

alimentação é optimizada, foi usa<strong>do</strong> um multiplica<strong>do</strong>r <strong>de</strong> 16 bits com autoteste, ten<strong>do</strong> em vista uma<br />

avaliação periódica da eventual ocorrência <strong>de</strong> falhas no processamento. Após uma calibração inicial,<br />

o mecanismo Sensor Global mais algoritmo <strong>de</strong> controlo <strong>de</strong>verá ser capaz <strong>de</strong> operar dinamicamente,<br />

ajustan<strong>do</strong>-se às condições <strong>de</strong> temperatura ou envelhecimento sem qualquer interferência <strong>do</strong><br />

utiliza<strong>do</strong>r e sem interferir com a funcionalida<strong>de</strong> implementada no circuito.<br />

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