System Generator for DSP リファレンスガイド - Xilinx

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R 読み出しまたは書き込みが行われることがあります。詳細は、チュートリアル : MicroBlaze プロセッサシステムの設計とシミュレーションおよびEDK Export Tool を参照してください。 • このブロックでは、 Verilog ネットリストはサポートされません。 MicroBlaze プロセッサのオンラインマニュアル関連項目 MicroBlaze の詳細は、次のサイトを参照してください。 http://japan.xilinx.com/xlnx/xebiz/designResources/ip_product_details.jsp?key=micro_blaze MicroBlaze プロセッサペリフェラルの設計とエクスポートチュートリアル : MicroBlaze プロセッサシステムの設計とシミュレーション EDK Export Tool 244 japan.xilinx.com System Generator for DSP リファレンス ガイドリリース 9.2.00 2007 年 8 月
ModelSim ModelSim このブロックは、 [Xilinx Blockset] の [Tools] および [Index] ライブラリにリストされています。 System Generator の Black Box ブロックを使用すると、既存の HDL ファイルをモデルに組み込むことができます。モデルがシミュレーションされると、協調シミュレーションを使用してブラックボックスがシミュレーションされるようにできます。この ModelSim HDL 協調シミュレーションブロックでは、 1 つまたは複数のブラックボックスの協調シミュレーションがコンフィギュレーションおよび制御できます。シミュレーション中は、各 ModelSim ブロックで ModelSim のコピーが作成され、ModelSim ライセンスが 1 つずつ使用されます。ライセンスが少ない場合は、複数のブラックボックスで同じブロックを共有できます。 ModelSim ブロックでは、次が実行されます。ブロックパラメータ • ブラックボックス HDL が ModelSim 内でシミュレーションされるようにするために必要な VHDL および Verilog を追加します。 • Simulink のシミュレーションが開始されると、 ModelSim セッションを開始します。 • Simulink と ModelSim 間の通信を媒介します。 • ブラックボックス HDL がコンパイルされたときにエラーがあれば、それをレポートします。 • シミュレーションが終了すると、 ModelSim を終了します。ブロックパラメータのダイアログボックスは、 Simulink モデル内のアイコンをダブルクリックすると表示されます。 [Basic] タブ [Basic] タブからは、次のようなパラメータを設定できます。 [Run co-simulation in directory] : ModelSim がここで指定したディレクトリで開始されます。ディレクトリが存在しない場合は作成されます。協調シミュレーション用に System Generator で生成される補助ファイルも含め、すべてのブラックボックスファイルがこのディレクトリにコピーされます。既存のファイルは自動的に上書きされます。ディレクトリは、相対パスまたは絶対パスのどちらでも指定できます。相対パスは、 Simulink の MDL ファイルがあるディレクトリを基準に解釈されます。 [Open waveform viewer] : オンにすると、 ModelSim 波形ウィンドウが自動的に開き、標準的な信号セットが表示されます。この信号には、すべてのブラックボックスの入力と出力、および System Generator から提供されるクロック信号とクロックイネーブル信号の入力と出力がすべて含まれます。信号表示は、補助的な Tcl スクリプトでカスタマイズできます。スクリプトを指定するには、 [Advanced] タブで [Add custom scripts] をオンにし、 [Script to run after "vsim"] にスクリプト名 (例 : myscript.do) を入力します。カスタマイズされた波形ビューアの例は、 /examples/black_box/example5 ディレクトリに含まれています。この例については、 ModelSim を使用したアドバンスブラックボックスの例を参照してください。 [Leave ModelSim open at end of simulation] : オンにすると、 Simulink シミュレーションが終了した後も ModelSim セッションが開いたままになります。 [Skip compilation (use previous results)] : オンにすると、 HDL 協調シミュレーション用の ModelSim ブロックを使用するブラックボックスすべての ModelSim コンパイルが実行されなく System Generator for DSP リファレンス ガイド japan.xilinx.com 245 リリース 9.2.00 2007 年 8 月 R
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System Generator for DSP リファ
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目次このマニュアルにつ
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目次ブロックインターフ
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目次ブロックパラメー
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目次ブロックパラメー
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目次ザイリンクス LogiCOR
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目次 CORDIC DIVIDER . . . . . . .
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目次 xlGenerateButton . . . . . .
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目次メンバーデータ . . .
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R このマニュアルについて
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表記規則オンラインマニ
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R ザイリンクスブロック
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ブロックセットライブ
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ブロックのパラメータダ
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ブロックのパラメータダ
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Accumulator Accumulator このブ
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Addressable Shift Register Addressa
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AddSub AddSub ブロックパラ
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Assert Assert ブロックパラ
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BitBasher BitBasher このブロッ
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BitBasher 制限 octal_const : 0、
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Black Box レートを生成する
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Black Box • 必要なポート
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Black Box ブロックパラメ
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Black Box 例関連項目次は
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ChipScope ブロックパラメ
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ChipScope 既知の問題詳細情
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Clock Enable Probe Clock Enable Pro
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CMult CMult ブロックパラメ
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Concat Concat このブロックは
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Configurable Subsystem Manager ブ
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Constant • [Operation select] : D
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Convert Convert このブロック
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Convolutional Encoder v3_0 System G
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Convolutional Encoder v6_0 System G
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Counter System Generator ブロッ
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DAFIR v9_0 係数のリロード
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DAFIR v9_0 System Generator ブロ
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DDS Compiler v1_1 ブロックイ
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DDS Compiler v1_1 System Generator
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DDS Compiler v2_0 ブロックイ
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DDS Compiler v2_0 System Generator
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DDS v4_0 System Generator ブロッ
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DDS v5_0 ブロックパラメー
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Delay Delay このブロックは
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Delay 最初の SRL では 16 サ
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Delay らないので、速度が
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Depuncture ブロックパラメ
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Down Sample Down Sample このブ
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Down Sample フレームの最後
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DSP48 • [Provide C port] : オン
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DSP48 Macro DSP48 Macro このブ
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DSP48 Macro • 次の図は、 [In
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DSP48 Macro 予約ポート名ポ
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DSP48 Macro モードの選択 DSP4
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DSP48 Macro DSP48 Macro の擬似 o
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DSP48A DSP48A このブロックは
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DSP48A 関連項目 • [Reset port
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DSP48E • [Pattern mask (48 bit he
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DSP48E • [Reset port for c] : オ
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Dual Port RAM Dual Port RAM この
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Dual Port RAM コリジョンビ
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Dual Port RAM System Generator ブ
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EDK Processor EDK Processor この
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EDK Processor 既知の問題 •
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FDATool FDATool 使用例このブ
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FFT v1_0 FFT v1_0 このブロッ
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FFT v1_0 FFT のタイミング特
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FFT v3_1 nfft_we アサートさ
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FFT v3_1 System Generator ブロッ
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FFT v3_2 入力信号 xn_re 入力
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FFT v3_2 • [Output ordering] :
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Page 169 and 170:
FFT v4_1 出力信号ブロック
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FFT v4_1 System Generator ブロッ
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FIR Compiler v1_0 FIR Compiler v1_0
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FIR Compiler v1_0 タコンフ
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FIR Compiler v2_0 FIR Compiler v2_0
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FIR Compiler v2_0 ブロックパ
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FIR Compiler v2_0 System Generator
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FIR Compiler v3_0 係数のリロ
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FIR Compiler v3_0 対称インタ
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FIR Compiler v3_0 既知の問題
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FIR Compiler v3_1 係数のリロ
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FIR Compiler v3_1 対称インタ
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Page 195 and 196: From FIFO System Generator ブロ
Page 197 and 198: From Register 関連項目 Domain_B
Page 199 and 200: Gateway In ば、次の OFFSET = IN
Page 201 and 202: Gateway Out とえば、次の OFFS
Page 203 and 204: Interleaver Deinterleaver v4_0 Inte
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Page 207 and 208: Interleaver Deinterleaver v5_0 ブ
Page 209 and 210: Inverter Inverter このブロッ
Page 211 and 212: JTAG Co-Simulation [Advanced] タ
Page 213 and 214: LFSR す。 [Galois] を選択す
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Page 217 and 218: MCode • 比較演算子 < より
Page 219 and 220: MCode 定数式これが使用で
Page 221 and 222: MCode スライス関数 : xl_slice
Page 223 and 224: MCode empty = v.empty; ベクタ
Page 225 and 226: MCode disp('disp(10) is'); disp(10)
Page 227 and 228: MCode end regs.push_front_pop_back(
Page 229 and 230: MCode Simulink のシミュレ
Page 231 and 232: MCode 次の図は、モデルを
Page 233 and 234: MCode end persistent ステート
Page 235 and 236: MCode 丸めを使用した xl_sta
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Page 243: MicroBlaze Processor 既知の問
Page 247 and 248: ModelSim タイムスケールカ
Page 249 and 250: ModelSim 上の図は、 System Gen
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Page 253 and 254: Multiple Subsystem Generator Genera
Page 255 and 256: Multiple Subsystem Generator 生成
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Page 261 and 262: Opmode PCIN)] の場合は、キ
Page 263 and 264: Parallel to Serial Parallel to Seri
Page 265 and 266: PicoBlaze Instruction Display PicoB
Page 267 and 268: PicoBlaze Microcontroller • [Disp
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Page 271 and 272: Puncture このブロックで使
Page 273 and 274: Reinterpret Reinterpret このブ
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Page 279 and 280: ROM • [Binary point] : メモリ
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Page 283 and 284: RS Decoder v5_1 ♦ [Custom] : ブ
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Page 287 and 288: RS Decoder v6_0 ♦ [ATSC] : ATSC (
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Page 291 and 292: RS Encoder v5_0 ♦ [CCSDS] : CCSDS
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RS Encoder v6_0 ♦ [CCSDS] : CCSDS
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Sample Time Sample Time このブ
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Serial to Parallel Serial to Parall
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Shared Memory 実行できるよ
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Shared Memory Memory ブロック
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Shared Memory Read ブロックパ
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Shared Memory Write ブロック
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Simulation Multiplexer Simulation M
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SineCosine SineCosine このブロ
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Single Port RAM Single Port RAM こ
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Single Port RAM 書き込みモー
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Single Port RAM 深さ別の最大
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Single-Step Simulation Single-Step
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System Generator System Generator
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System Generator ♦ [Default] :
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System Generator ♦ [Input data ty
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Time Division Demultiplexer Time Di
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Time Division Multiplexer Time Divi
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To FIFO System Generator ブロッ
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To Register クロックドメ
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Toolbar ツールバーメニュ
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Up Sample Up Sample このブロッ
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Viterbi Decoder v5_0 Viterbi Decode
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Viterbi Decoder v5_0 System Generat
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Viterbi Decoder v6_0 ます。 sel
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WaveScope WaveScope このブロッ
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WaveScope [hex] をオンにし、
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WaveScope 2 つ目の選択方法
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WaveScope クリックする
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WaveScope マウスポインタ
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WaveScope [Move Cursor Last] 一番
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Xilinx LogiCORE のバージョ
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Xilinx LogiCORE のバージョ
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R 第 2 章ザイリンクスリ
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2 Channel Decimate by 2 MAC FIR Fil
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2n-tap Linear Phase MAC FIR Filter
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4-channel 8-tap Transpose FIR Filte
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5x5Filter 5x5Filter 5 つの n-tap
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BPSK AWGN Channel BPSK AWGN Channel
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CIC Filter ブロックパラメ
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Convolutional Encoder ブロック
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CORDIC DIVIDER CORDIC DIVIDER ブ
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CORDIC LOG 参考資料 1. J. E. Vo
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CORDIC SQRT CORDIC SQRT Hyperbolic
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Dual Port Memory Interpolation MAC
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m-channel n-tap Transpose FIR Filte
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Mealy State Machine 例ミーリ
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Moore State Machine Moore State Mac
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Moore State Machine マトリッ
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Multipath Fading Channel Model イ
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Multipath Fading Channel Model デ
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Multipath Fading Channel Model タ
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n-tap Dual Port Memory MAC FIR Filt
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Registered Mealy State Machine Regi
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Registered Mealy State Machine ブ
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Registered Moore State Machine 例
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Virtex Line Buffer Virtex Line Buff
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Virtex2 5 Line Buffer Virtex2 5 Lin
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White Gaussian Noise Generator Box-
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R ザイリンクス XtremeDSP キ
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XtremeDSP Co-simulation XtremeDSP C
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XtremeDSP DAC XtremeDSP DAC モデ
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XtremeDSP LED Flasher XtremeDSP LED
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R System Generator ユーティ
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xlAddTerms optionStruct 引数は
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xlAddTerms 関連項目「Toolbar
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xlfda_numerator xlfda_numerator 構
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xlgetparam および xlsetparam xlg
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xlInstallPlugin xlInstallPlugin 構
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xlSetNonMemMap xlSetNonMemMap 構
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xlSBDBuilder xlSBDBuilder 構文
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xlTBUtils 例フィールド名
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xlTimingAnalysis xlTimingAnalysis
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xlUpdateModel ♦ 加えた変更
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xlVersion xlVersion 構文説明
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R プログラムを使用したア
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プログラムを使用した
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SharedMemory SharedMemory Public
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SharedMemory パラメータ name
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SharedMemory 戻り値読み出し
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LockableSharedMemory LockableShared
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LockableSharedMemory 戻り値 arg
Page 459 and 460:
SharedMemoryProxy SharedMemoryProxy
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SharedMemoryProxy Sysgen::StdLogicV
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NamedPipeReader NamedPipeReader Pub
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NamedPipeReader unsigned getNWords
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NamedPipeWriter メンバー関数
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索引数字 2 Channel Decimate by
Page 471 and 472:
索引さザイリンクス Logi
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