Dispense del corso - Dipartimento Ingegneria dell'Informazione ...
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Facoltà di <strong>Ingegneria</strong> 61<br />
viene inviato all’ingresso di un circuito PLL (Phase Locked Loop), che<br />
è formato da un moltiplicatore, un filtro passa-basso ed un VCO. Il segnale<br />
z ′<br />
(t) viene moltiplicato per un segnale a frequenza 2f0 generata<br />
localmente dal VCO, cioè per un segnale<br />
Il segnale dopo il filtro passa-basso risulta<br />
w(t) = sen(4πf0t). (4.79)<br />
e(t) ∼ =<br />
2 V0 ∆f · sen(θ). (4.80)<br />
4<br />
Questo segnale pilota il VCO, genera w(t) e viene inviato al moltiplicatore<br />
<strong>del</strong> PLL ed a un blocco che divide la frequenza per 2. La<br />
frequenza recuperata in questo modo è quella utilizzata per effettuare<br />
la demodulazione coerente <strong>del</strong> segnale ricevuto.