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Circuits et systemes de modelisation analogique de neurones ...

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Chapitre II : circuits <strong>analogique</strong>s élémentairestensions d'alimentations ont fait apparaître <strong>de</strong>s eff<strong>et</strong>s physiques au niveau du composant quiétaient négligeables jusqu'alors. La prise en compte <strong>de</strong> ces nouveaux phénomènes estessentielle pour les concepteurs qui utilisent <strong>de</strong> plus en plus <strong>de</strong> transistors MOS dans leurscircuits <strong>analogique</strong>s [VITTOZ 85], [TSIVIDIS 94].Daniel FOTY [FOTY 96] classe les différents modèles spice en trois générations successives : Level1, level2 <strong>et</strong> level3 forment la première génération. Ces modèles utilisent <strong>de</strong>séquations physiques relativement simples pour décrire le transistor. La <strong>de</strong>uxième génération, composée <strong>de</strong>s modèles BSIM1, HSPICE level28 <strong>et</strong> BSIM2,introduit un grand nombre <strong>de</strong> paramètres empiriques <strong>et</strong> une utilisation extensive <strong>de</strong>fonctions mathématiques <strong>de</strong>stinées à améliorer le comportement du simulateur. Enfin, la troisième génération, BSIM3, MOS Mo<strong>de</strong>l 9 <strong>de</strong> Philips <strong>et</strong> EKV répond à <strong>de</strong>ux butprincipaux : la modélisation à <strong>de</strong>stination <strong>de</strong> la conception <strong>analogique</strong> <strong>et</strong> le r<strong>et</strong>our à <strong>de</strong>sparamètres ayant un sens plus physique.Nous disposons <strong>de</strong> <strong>de</strong>ux types <strong>de</strong> modèles MOS53 (BSIM3V3) <strong>et</strong> MOS15 (level2 modifié parAMS pour rendre continue l'expression du courant <strong>et</strong> <strong>de</strong> sa dérivée lors <strong>de</strong>s changements <strong>de</strong>mo<strong>de</strong> <strong>de</strong> fonctionnement). Le modèle BSIM3V3 est le plus adapté à nos travaux, c'est celuique nous utilisons.Un régime <strong>de</strong> fonctionnement du transistor MOS, la polarisation sous le seuil, présente unintérêt particulier pour notre groupe. Il nous perm<strong>et</strong>trait en eff<strong>et</strong> d'utiliser une technologieCMOS <strong>et</strong> d'éviter ainsi l'utilisation <strong>de</strong> la technologie BiCMOS un peu plus complexe <strong>et</strong> plusonéreuse (voir paragraphe 2.2). La prise en compte <strong>de</strong> ce mo<strong>de</strong> <strong>de</strong> fonctionnement estcependant problématique <strong>et</strong> représente un exemple typique <strong>de</strong>s limites <strong>de</strong> la modélisation dutransistor MOS.Pour une tension grille-source V GS inférieure au seuil V th , le courant <strong>de</strong> canal <strong>de</strong>vient trèsfaible mais non-nul. Il ne suit néanmoins plus l'expression quadratique classique, mais dépen<strong>de</strong>xponentiellement <strong>de</strong> la tension <strong>de</strong> comman<strong>de</strong> V GS :W V GS V DSID kx. .exp 1 - exp(2.1)L nUT UT avec : - k X (V BS ) paramètre dépendant <strong>de</strong> la technologie <strong>et</strong> <strong>de</strong> V BS ,47

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