Modo 1 - PoliformaT
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Expansión de Entrada/Salida digital<br />
S0<br />
S1<br />
S2<br />
Expansión de E/S con lógica discreta<br />
• Expansión de las salidas<br />
4<br />
4<br />
4<br />
– Ejemplo: Construir 3 salidas S0 a S2 de 4 bits cada una<br />
con menos de 8 líneas en el uC<br />
• C) Mapeando los latches<br />
Latch<br />
LE<br />
Latch<br />
LE<br />
Latch<br />
LE<br />
– Sw para escribir en una salida<br />
CS S2<br />
CS S1<br />
4<br />
CS S0<br />
A15-A0 uC<br />
Circuito<br />
Decodif.<br />
Activas a nivel<br />
alto (como LE)<br />
D7-D0 uC<br />
– También podíamos haber operando CS Si con AND NOT(/WR uC )<br />
Contenidos sujetos a una Licencia Creative Commons 2.5:<br />
Reconocimiento – No comercial – Sin Obra Derivada<br />
/RDuC /WRuC DATOS<br />
DIR<br />
RAM-1<br />
/CS<br />
/RD<br />
/WR<br />
DATOS<br />
DIR<br />
RAM-2<br />
/CS<br />
/RD<br />
/WR<br />
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