AGRADECIMIENTOS
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4. DESARROLLO DEL PROTOCOLO USB.<br />
Se puede comparar el valor respondido con la configuración que se introduce<br />
en el programa, 09 es la longitud del descriptor, 02 indica que es el de configuración,<br />
20 00 la longitud total, en decimal 32, primero se envía el byte de menor peso, aunque<br />
aquí ya está representado cada byte en el orden de su significado, siendo el 2 el de<br />
mayor peso, byte a byte se establece en el orden que llega.<br />
4.3.3 Módulos auxiliares<br />
Hay cuatro pequeños módulos más en la implementación, T2, DSP_Z,<br />
RAM_CTRL11_SYN y LPM_RAM_IO cuyas funciones se explican a continuación.<br />
El T2 es un timer o clock que adapta el período de la señal de la placa al<br />
período utilizado en el conjunto del modulo. Como para la transmisión USB se trabaja<br />
a 12MHz y el clock de la placa lo hace a 24 Mhz, hay que dividir entre 2 su período, y<br />
para ello se cambia el nivel del clock interno cada flanco de subida del clock general,<br />
de este modo convertimos un período en medio.<br />
El DSP_Z es un módulo encargado de dejar en alta impedancia las salidas<br />
dirigidas al DSP_Z evitando que cuando este esté en uso, diferencias de nivel<br />
sobrecalienten el chip.<br />
LPM_RAM_IO es un módulo preconstruido que implementa una memoria RAM<br />
lógica, y puede tener varias formas y usos en función de su configuración previa. Se<br />
configura con los siguientes parámetros: LPM_WIDTH igual a 64 que será el buffer de<br />
salida; LPM_WIDTHAD igual a ocho que será el tamaño del buffer que direcciona<br />
todas las posibles celdas de 64 bits de la RAM; LPM_INDATA con valor REGISTERED<br />
especifica que el valor de los datos de entrada deben fijarse en el bus por el inclock o<br />
el outclock antes de realizar la operación; LPM_OUTDATA con valor REGISTERED<br />
especifica que el valor de los datos de salida deben fijarse en el bus durante el flanco<br />
de subida del outclock antes de aparecer en el buffer,;LPM_ADDRESS_CONTROL<br />
con valor REGISTERED especifica que las señales we, memenab y address[ ] solo<br />
tendrán efecto durante el flanco de subida del inclock, es decir, estos parámetros<br />
colocan la RAM en un modo de funcionamiento síncrono. Es totalmente<br />
desaconsejable tratar de utilizar la memoria en modo asíncrono pues el control del