HLASM Language Reference
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Addressing 74 HLASM V1R5 Language Reference
Part 2. Machine and Assembler Instruction Statements Part 2. Machine and Assembler Instruction Statements Chapter 4. Machine Instruction Statements . . . . . . . . . . . . . . . . . . . 78 General Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78 Decimal Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79 Floating-Point Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79 Control Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79 Input/Output Operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80 Branching with Extended Mnemonic Codes . . . . . . . . . . . . . . . . . . . . . 80 | Alternative Mnemonics for some Branch Relative Instructions . . . . . . . . . 83 Statement Formats . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83 Symbolic Operation Codes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84 Operand Entries . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85 Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86 Register Usage by Machine Instructions . . . . . . . . . . . . . . . . . . . . 86 Register Usage by System . . . . . . . . . . . . . . . . . . . . . . . . . . . 87 Addresses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87 Implicit Address . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88 Explicit Address . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88 Relative Address . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88 Relocatability of Addresses . . . . . . . . . . . . . . . . . . . . . . . . . . . 89 Machine or Object Code Format . . . . . . . . . . . . . . . . . . . . . . . . 89 Lengths . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90 Immediate Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91 Examples of Coded Machine Instructions . . . . . . . . . . . . . . . . . . . . . . 91 RI Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91 RR Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93 RS Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94 RSI Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95 RX Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95 SI Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97 SS Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97 Chapter 5. Assembler Instruction Statements . . . . . . . . . . . . . . . . . 100 64-bit Addressing Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101 *PROCESS Statement . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 102 ACONTROL Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103 ADATA Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107 AINSERT Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108 ALIAS Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109 AMODE Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110 CATTR Instruction (MVS and CMS) . . . . . . . . . . . . . . . . . . . . . . . . . 112 CCW and CCW0 Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115 CCW1 Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116 CEJECT Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 118 CNOP Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119 COM Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 121 COPY Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 122 CSECT Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123 CXD Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 125 DC Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 126 Rules for DC Operand . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128 © Copyright IBM Corp. 1982, 2004 75
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- Page 116 and 117: Examples of Coded Machine Instructi
- Page 118 and 119: Examples of Coded Machine Instructi
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- Page 122 and 123: *PROCESS Statement *PROCESS Stateme
- Page 124 and 125: ACONTROL Instruction ►►──
- Page 126 and 127: ACONTROL Instruction FLAG(PAGE0) in
- Page 128 and 129: AINSERT Instruction character_strin
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- Page 132 and 133: CATTR Instruction Figure 25. AMODE/
- Page 134 and 135: CATTR Instruction | statements for
- Page 136 and 137: CCW1 Instruction data_count is an a
- Page 138 and 139: CEJECT Instruction If symbol is an
- Page 140 and 141: CNOP Instruction Figure 29 (Page 2
- Page 142 and 143: COPY Instruction In the following e
Part 2. Machine and Assembler Instruction Statements<br />
Part 2. Machine and Assembler Instruction Statements<br />
Chapter 4. Machine Instruction Statements . . . . . . . . . . . . . . . . . . . 78<br />
General Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78<br />
Decimal Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79<br />
Floating-Point Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79<br />
Control Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79<br />
Input/Output Operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80<br />
Branching with Extended Mnemonic Codes . . . . . . . . . . . . . . . . . . . . . 80<br />
| Alternative Mnemonics for some Branch Relative Instructions . . . . . . . . . 83<br />
Statement Formats . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83<br />
Symbolic Operation Codes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84<br />
Operand Entries . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85<br />
Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86<br />
Register Usage by Machine Instructions . . . . . . . . . . . . . . . . . . . . 86<br />
Register Usage by System . . . . . . . . . . . . . . . . . . . . . . . . . . . 87<br />
Addresses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87<br />
Implicit Address . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88<br />
Explicit Address . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88<br />
Relative Address . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88<br />
Relocatability of Addresses . . . . . . . . . . . . . . . . . . . . . . . . . . . 89<br />
Machine or Object Code Format . . . . . . . . . . . . . . . . . . . . . . . . 89<br />
Lengths . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90<br />
Immediate Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91<br />
Examples of Coded Machine Instructions . . . . . . . . . . . . . . . . . . . . . . 91<br />
RI Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91<br />
RR Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93<br />
RS Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94<br />
RSI Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95<br />
RX Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95<br />
SI Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97<br />
SS Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97<br />
Chapter 5. Assembler Instruction Statements . . . . . . . . . . . . . . . . . 100<br />
64-bit Addressing Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101<br />
*PROCESS Statement . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 102<br />
ACONTROL Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103<br />
ADATA Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107<br />
AINSERT Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108<br />
ALIAS Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109<br />
AMODE Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110<br />
CATTR Instruction (MVS and CMS) . . . . . . . . . . . . . . . . . . . . . . . . . 112<br />
CCW and CCW0 Instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115<br />
CCW1 Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116<br />
CEJECT Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 118<br />
CNOP Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 119<br />
COM Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 121<br />
COPY Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 122<br />
CSECT Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123<br />
CXD Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 125<br />
DC Instruction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 126<br />
Rules for DC Operand . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128<br />
© Copyright IBM Corp. 1982, 2004 75
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