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外 部 割 込 みに 使 用 するコントロールレジスタ<br />
割 込 みを 制 御 するレジスタの 内 , 外 部 割 込 み IRQ0~3 に 関 係 するレジスタは 次 のとおりです。<br />
なお, 外 部 割 込 みに 関 係 するビットは 黄 色 でマークしています。<br />
割 込 みエッジセレクトレジスタ 1(IEGR1<br />
IEGR1) : アドレス=0xFFF2<br />
番 地<br />
ビット ビット 名 初 期曋 値 R/W 説 明<br />
7 NMIEG 0 R/W NMI エッジセレクト。<br />
0:NMI 入 力 端 子 の 立 ち 下 がりエッジを 検 出 。<br />
1:NMI 入 力 端 子 の 立 ち 上 がりエッジを 検 出 。<br />
6 - 1 - リザーブビット。リードすると 常 に 1 が 読 み 出 される。<br />
5 - 1 - リザーブビット。リードすると 常 に 1 が 読 み 出 される。<br />
4 - 1 - リザーブビット。リードすると 常 に 1 が 読 み 出 される。<br />
3 IEG3 0 R/W IRQ3 エッジセレクト。<br />
0:IRQ3 入 力 端 子 の 立 ち 下 がりエッジを 検 出 。<br />
1:IRQ3 入 力 端 子 の 立 ち 上 がりエッジを 検 出 。<br />
2 IEG2 0 R/W IRQ2 エッジセレクト。<br />
0:IRQ2 入 力 端 子 の 立 ち 下 がりエッジを 検 出 。<br />
1:IRQ2 入 力 端 子 の 立 ち 上 がりエッジを 検 出 。<br />
1 IEG1 0 R/W IRQ1 エッジセレクト。<br />
0:IRQ1 入 力 端 子 の 立 ち 下 がりエッジを 検 出 。<br />
1:IRQ1 入 力 端 子 の 立 ち 上 がりエッジを 検 出 。<br />
0 IEG0 0 R/W IRQ0 エッジセレクト。<br />
0:IRQ0 入 力 端 子 の 立 ち 下 がりエッジを 検 出 。<br />
1:IRQ0 入 力 端 子 の 立 ち 上 がりエッジを 検 出 。<br />
割 込 みイネーブルレジスタ 1(IENR1<br />
IENR1) : アドレス=0xFFF4<br />
番 地<br />
ビット ビット 名 初 期曋 値 R/W 説 明<br />
7 IENDT 0 R/W 直 接 遷 移 割 込 み 要 求 イネーブル。<br />
0:ディセーブル。 / 1:イネーブル。<br />
6 IENTA 0 R/W RTC 割 込 み 要 求 イネーブル。<br />
0:ディセーブル。 / 1:イネーブル。<br />
5 IENWP 0 R/W ウェイクアップ 割 込 み 要 求 イネーブル。(WKP0~5 共 通 )<br />
0:ディセーブル。 / 1:イネーブル。<br />
4 - 1 - リザーブビット。リードすると 常 に 1 が 読 み 出 される。<br />
3 IEN3 0 R/W IRQ3 割 込 み 要 求 イネーブル。<br />
0:ディセーブル。 / 1:イネーブル。<br />
2 IEN2 0 R/W IRQ2 割 込 み 要 求 イネーブル。<br />
0:ディセーブル。 / 1:イネーブル。<br />
1 IEN1 0 R/W IRQ1 割 込 み 要 求 イネーブル。<br />
0:ディセーブル。 / 1:イネーブル。<br />
0 IEN0 0 R/W IRQ0 割 込 み 要 求 イネーブル。<br />
0:ディセーブル。 / 1:イネーブル。<br />
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TK-3687mini ユーザーズマニュアル C 言 語 版