Design Flow und Verilog
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ProzedurenProzedurentask Prozedurname;input Signal1;output Signal2;inout Signal3;beginAnweisung1;...AnweisungN;endendtaskDefinition derArgumente,Anzahl beliebig• Konzept ähnlich den Programmiersprachen: Mehrfachnutzungdes Codes (design re-use)• Aufruf der Prozedur: Prozedurname(Liste der Argumente);• Argumente werden gemäß ihrer Reihenfolge bei der Definitionin der Prozedur interpretiert• Werden zu dem Zeitpunkt des Aufrufs ausgeführtDST SS2003 - Hardware Description LanguagesSuS@TI, Seite 38
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