Design Flow und Verilog
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Verhaltensbasierte Beschreibungmodule MUX (A,B,C,D,Sel0,Sel1,Z);input A,B,C,D,Sel0,Sel1;output Z;reg Z;ABCZalways @(A or B or C or D or Sel0 or Sel1)begincase ({Sel1, Sel0})2’b00 : Z = A;2’b01 : Z = B;2’b10 : Z = C;2’b11 : Z = D;default : Z = 1’bx;endcaseendendmoduleDSel0Sel1• Modellierung des Verhaltens durch eineBeschreibung nahe am Algorithmus• Worin unterscheiden sich Algorithmen inSoftware zu Algorithmen für Hardware?• Antwort: Durch spezielle HDL-Konstrukte<strong>und</strong> sog. Coding-StylesDST SS2003 - Hardware Description LanguagesSuS@TI, Seite 31
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