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Optimierung der elektrischen Eigenschaften von lateralen ...

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Kapitel 5 Dynamisches Verhalten <strong>von</strong> SJ‐LDMOS‐Transistoren 117<br />

_________________________________________________________________________________________________________________<br />

Gl. (5.6) behält ihre Gültigkeit, unter <strong>der</strong> Bedingung, dass die konstante Gatespan‐<br />

nung UGS größer ist als die Einsatzspannung <strong>der</strong> n‐Driftzone:<br />

n dox<br />

UGS = const > U FB + 2ψB+ ⋅ 4εSiqNDψ<br />

B<br />

(5.8)<br />

ε<br />

mit dem Bulk‐Fermi‐Potential<br />

ox<br />

kT ⎛ ND<br />

⎞<br />

ψ B = ⋅ln ⎜ ⎟<br />

q ⎝ ni⎠<br />

(5.9)<br />

Aufgrund <strong>der</strong> Tatsache, dass die Einsatzspannung <strong>der</strong> n‐Driftzone (Summation aller<br />

Terme auf <strong>der</strong> rechten Seite <strong>von</strong> Gl. (5.8)) deutlich negativ ist und dass die Steuer‐<br />

spannung UGS für selbstsperrende n‐Kanaltransistoren niemals unter einen negativen<br />

Wert sinkt, wird die oben angegebene Bedingung immer eingehalten.<br />

Abbildung 5.4: Verlauf <strong>von</strong> Cgd über UDS mit UGS als Parameter.<br />

Die Cgd/UDS–Kurve ist in Abb. 5.4 für verschiedene Werte <strong>von</strong> UGS dargestellt, sie ver‐<br />

schiebt sich mit zunehmen<strong>der</strong> Gatespannung UGS immer mehr nach rechts. Sofern<br />

n<br />

die Drainspannung UDS kleiner als die Summe UGS + U FB liegt, wobei UGS konstant<br />

gehalten wird, wirk das Potential <strong>der</strong> Gateelektrode gegenüber dem Potential <strong>der</strong><br />

Drainelektrode positiv. Es stellt sich eine Anreicherung <strong>von</strong> Elektronen im Überlap‐<br />

pungsgebiet vom Gate über die Driftzone unter dem Gatekontakt ein, so dass Cgd ≈<br />

n<br />

Cox gilt. Überschreitet die Drainspannung UDS den Wert UGS + U FB , wird die Polung<br />

zwischen Gate‐ und Drainelektrode umgekehrt, dabei stellt sich eine Verarmung an

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