Logikfamilien - Lehrstuhl fÃ¼r Schaltungstechnik und Simulation

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TTL mit Totem-Pole Ausgang Ausgangsstufe wird durch zwei Transistoren ersetzt, die nach V CCoder Masse ziehen. Beispiel NAND2:V CC4kΩ 1.6kΩ 130ΩV CC/ 0.8VM3Diode verhindertStromfluß in M3for Q=GNDAB0V / 1.6VGND / 0.8VQV CC-ε / 0V1kΩ High-Level wird mit Transistor erzeugt,der abgeschaltet werden kann. Daher niedrigerer Stromverbrauch Kein 'Wired-AND' am Ausgang mehr möglich NOR Gates etwas komplizierter Verbesserungen: Schottky-Diode verhindern Sättigung der Transistoren ⇒ 74Sxx oder 74LSxx (low power)GNDNOR2Digitale Schaltungstechnik 2005 - LogikfamilienP. Fischer, TI, Uni Mannheim, Seite 69
SPICE Simulation TTL Inverter4k1.6k130cQ4IinQ1aQ2VoutV(b) = V(c)0VdcVINVbVQ3VV21k5V0⇒ SPICE SimulationDigitale Schaltungstechnik 2005 - LogikfamilienP. Fischer, TI, Uni Mannheim, Seite 70
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Unterschiede in Logikfamilien Techn
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Signalpegel des Inverters mit resis
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Berechnung V OL Berechnung der Low-
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Pseudo-NMOS NAND4 GatterVDDn + -Kon
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Ausblick: Pseudo NMOS mit Adaptiver
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Dynamische Logik mit 'Precharge'2 P
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Layout eines dynamischen NAND3 Gatt
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