Logikfamilien - Lehrstuhl fÃ¼r Schaltungstechnik und Simulation

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Signalpegel verschiedener LastinverterQuerstromWiderstandAusgangskennlinie desNMOS für V in = VDDNMOS enh.PMOS,NMOS depl.AusgangsspannungAusgangspegelV OH ist (dynamisch)nicht VDD!)VDDDigitale Schaltungstechnik 2005 - LogikfamilienP. Fischer, TI, Uni Mannheim, Seite 6
Berechnung V OL Berechnung der Low-Ausgangsspannung aus der Ausgangskennlinie von NMOS und LastI querNMOSPMOSV OLVDD V out NMOS ist im linearen Bereich, PMOS in Sättigung Mit V T= V TN= |V TP|:I NMOS = k N [(V DD – V T ) V OL – ½ V OL 2 ] = ½ k P (V DD – V T ) 2 = I PMOSV OL = (V DD -V T ) [1 – 1 – k P /k N ] k pmuß viel kleiner als k nsein !!! Das low-level hängt stark von V DDab – schlecht!Digitale Schaltungstechnik 2005 - LogikfamilienP. Fischer, TI, Uni Mannheim, Seite 7
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Seite 11 und 12: Ausblick: Pseudo NMOS mit Adaptiver
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Seite 15 und 16: Layout eines dynamischen NAND3 Gatt
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Seite 21 und 22: CMOS Inverter Transferkennlinie Ent
Seite 23 und 24: Test: Transfer Charakteristik (DC s
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BiCMOS Logik Durch die gleichzeitig
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Single ended: TTL CMOS ECL GTLSigna
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Ein paar Logik-FamilienDigitale Sch
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Entwicklung LogikfamilienQuelle: Te
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