Grundlagen der Informatik III Wintersemester 2010/2011 â 28 ...
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Altera - NIOS II<br />
◮ 32 General Purpose Register<br />
Nios II Processor Core<br />
Tightly Coupled<br />
JTAG<br />
interface<br />
to software<br />
debugger<br />
reset<br />
clock<br />
cpu_resetrequest<br />
cpu_resettaken<br />
JTAG<br />
Debug Module<br />
Program<br />
Controller<br />
&<br />
Address<br />
Generation<br />
Exception<br />
General<br />
Purpose<br />
Registers<br />
Control<br />
Registers<br />
Instruction<br />
Cache<br />
Instruction Memory<br />
Tightly Coupled<br />
Instruction Memory<br />
Instruction Bus<br />
Controller<br />
irq[31..0]<br />
Interrupt<br />
Controller<br />
Instruction<br />
Regions<br />
Memory<br />
Memory<br />
Management<br />
Unit<br />
Protection<br />
Unit<br />
Translation<br />
Data<br />
Regions<br />
Lookaside<br />
Buffer<br />
Data Bus<br />
Custom<br />
I/O<br />
Signals<br />
Custom<br />
Instruction<br />
Logic<br />
Arithmetic<br />
Logic Unit<br />
Data<br />
Cache<br />
Tightly Coupled<br />
Data Memory<br />
Tightly Coupled<br />
Data Memory<br />
9. Februar <strong>2011</strong> | Technische Universität Darmstadt | Dr.-Ing. Wolfgang Heenes | 37
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