Vorlesung Rechnerarchitektur - Fachbereich Informatik
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B eis piele für einen 16/32 B it Ins truktions s a tz (A R M<br />
Thum b2)<br />
15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0<br />
opcode<br />
opcode<br />
00xxxx<br />
Instruction or instruction class<br />
Shift (immediate), add, subtract, move, and compare<br />
010000 Data processing<br />
010001 Special data instructi<br />
01001x<br />
0101xx<br />
011xxx<br />
100xxx<br />
10100x<br />
10101x<br />
1011xx<br />
11000x<br />
11001x<br />
1101xx<br />
11100x<br />
Load from Literal Pool, see LDR (literal)<br />
Load/store single data item<br />
Generate PC-relative address, see ADR<br />
Generate SP-relative address, see ADD (SP plus immediate)<br />
Miscellaneous 16-bit instructi<br />
Store multiple registers, see STM / STMIA / STMEA<br />
Load multiple registers, see LDM / LDMIA / LDMFD<br />
Conditional branch, and supervisor call<br />
Unconditional Branch, see B<br />
<strong>Vorlesung</strong> <strong>Rechnerarchitektur</strong><br />
© Gerhard Raffius, WS 2009/10, h_da - <strong>Fachbereich</strong> <strong>Informatik</strong><br />
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