Gecko3 - CCC Event Weblog

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E. Quellcode 132 } for ( i = 0 x0000 ; i < 5 1 0 ; i++ ) // l oop SPI Flash data to EP6IN { EXTAUTODAT2 = readBlock ( ) ; // w r i t e data b y t e from SPI Flash to d e s t i n a t i o n a d r e s s EXTAUTODAT2 = lastBlockRead ( ) ; // w r i t e data b y t e from SPI Flash to d e s t i n a t i o n a d r e s s SYNCDELAY; EP4BCH = 0 x02 ; 137 SYNCDELAY; EP4BCL = 0 x00 ; s p i f l a s h a d d r e s s =0x200 ; } f l a s h r d e n = 0 ; 142 } // arm EP6IN void b o o t l o a d c f g ( void ) { BOOL busy ; // v a i a b l e f o r busy check 147 WORD i ; // counter f o r s t a r t u p sequence unsigned long a d d r e s s = 0 , counter ; // s t a r t a d r e s s f o r read i n s t r u c t i o n , b y t e counter // Read t h e s w i t c h to d e t e c t in witch address range t h e c o n f i g u r a t i o n s h o u l d be w r i t t e n i f ( s w i t c h r d ( ) == highaddr memory range ) { 152 l e d w r (0 x06 ) ; a d d r e s s = 0 x100000 ; } GPIFIDLECTL &= 0xF9 ; // b r i n g CS B , RDWR B low 157 PA5 = 0 ; // b r i n g Prog B low b r i n g s t h e d e v i c e in t h e i n i t a l i s a t i o n mode // and h o l d i t t h e r e PA5 = 1 ; // b r i n g Prog B b i t h i g h 162 while (PA4 == 0) // i f I n i t B goes h i g h t h e d e v i c e i s in t h e c o n f i g u r a t i o n l o a d mode { ; } 167 IOB = startBlockRead ( a d d r e s s ) ; // d r i v e Port B with f i r s t data b y t e GPIFIDLECTL &= 0xFE ; // b r i n g CCLK low GPIFIDLECTL |= 0 x01 ; // b r i n g CCLK h i g h 172 for ( counter = 0 ; counter < ( f i l e s i z e −2) ; counter++) { IOB = readBlock ( ) ; // d r i v e Port B with data b y t e GPIFIDLECTL &= 0xFE ; // b r i n g CCLK low 177 GPIFIDLECTL |= 0 x01 ; // b r i n g CCLK h i g h // check f o r busy do { 182 busy = PA7 ; // read busy b i t i f ( busy == TRUE) { GPIFIDLECTL &= 0xFE ; // b r i n g CCLK low GPIFIDLECTL |= 0 x01 ; // b r i n g CCLK h i g h 187 } i f (PA7 == TRUE) // i f DONE i s set , a b o r t t h e busy check because a f t e r { // c o n f i g u r a t i o n i s complete t h e DONE b i t has a undefined v a l u e 80 Matthias Zurbrügg, Christoph Zimmermann
E.1. Firmware busy = FALSE ; } 192 } while ( busy == TRUE) ; } IOB = lastBlockRead ( ) ; // d r i v e Port B with l a s t data b y t e 197 GPIFIDLECTL &= 0xFE ; // b r i n g CCLK low GPIFIDLECTL |= 0 x01 ; // b r i n g CCLK h i g h GPIFIDLECTL |= 0 x06 ; // b r i n g CS B , RDWR B h i g h 202 for ( i =0; i
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Literaturverzeichnis [Bre03] Ulrich
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