Gecko3 - CCC Event Weblog
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8. Ausblick<br />
Dieses Kapitel soll den weiteren Projektverlauf aufzeigen.<br />
8.1. Weiteres Vorgehen<br />
8.1.1. Firmware<br />
• Planung und Realisation eines Protokolls, das im Kommunikationsmodus die Datenlänge<br />
die der FPGA senden will, dem Host mitteilt.<br />
• GPIF auf 16 Bit Busbreite konfigurieren<br />
• Schalter über I 2 C einlesen, der bestimmt von welchem Teil des SPI Flashs die Konfiguration<br />
geladen wird<br />
• Status der Firmware über I 2 C an LEDs ausgeben<br />
• Das nichtsetzen des FIFO Buffer Full Flags analysieren<br />
• Wenn nötig EEPROM und SPI Flash Lesefunktionen ausbauen<br />
• FPGA Typ von Firmware auslesen, damit die Grösse der Konfigurationsdatei nicht<br />
mehr manuell im C-Code definiert werden muss<br />
8.1.2. Hostsoftware<br />
• Windows Portierung<br />
• Test mit USB 1.1, da während unserer Arbeit kein USB 1.1 Hub zur Verfügung stand<br />
• Test auf 64 Bit Computern und Betriebssystemen<br />
• Flash und EEPROM auslese Funktionen<br />
• Entwicklung einer Applikation um das Intel NOR Flash zu beschreiben<br />
8.1.3. FPGA Cores<br />
• Ansteuerung des Intel NOR Flashs<br />
• Bei Bedarf verbesserung der Testroutinen<br />
• Entwicklung eines einfachen Referenzsystems<br />
• Schreiben von Testroutinen für die weiteren Funktionsblöcke<br />
Project Report 43
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