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E. Quellcode 163 /∗ Opcode∗/ 0x01 , 0x01 , 0x01 , 0x02 , 0x05 , 0x01 , 0x01 , 0x00 , /∗ Output ∗/ 0x00 , 0x00 , 0x04 , 0x04 , 0x00 , 0x00 , 0x04 , 0x00 , /∗ LFun ∗/ 0x00 , 0x36 , 0x00 , 0x00 , 0x41 , 0x00 , 0x09 , 0x3F , // Wave 1 /∗ LenBr ∗/ 0x01 , 0x11 , 0x01 , 0x20 , 0x25 , 0x3D , 0x01 , 0x07 , 168 /∗ Opcode∗/ 0x01 , 0x01 , 0x02 , 0x05 , 0x01 , 0x01 , 0x00 , 0x00 , /∗ Output ∗/ 0x00 , 0x02 , 0x02 , 0x00 , 0x00 , 0x04 , 0x04 , 0x00 , /∗ LFun ∗/ 0x41 , 0x09 , 0x00 , 0x36 , 0x09 , 0x09 , 0x00 , 0x3F , // Wave 2 /∗ LenBr ∗/ 0x01 , 0x01 , 0x01 , 0x01 , 0x01 , 0x01 , 0x01 , 0x07 , 173 /∗ Opcode∗/ 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , /∗ Output ∗/ 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , /∗ LFun ∗/ 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x3F , // Wave 3 /∗ LenBr ∗/ 0x01 , 0x01 , 0x01 , 0x01 , 0x01 , 0x01 , 0x01 , 0x07 , 178 /∗ Opcode∗/ 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , /∗ Output ∗/ 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , /∗ LFun ∗/ 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x00 , 0x3F , } ; // END DO NOT EDIT 183 // DO NOT EDIT . . . const char xdata FlowStates [ 3 6 ] = { /∗ Wave 0 FlowStates ∗/ 0x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 188 /∗ Wave 1 FlowStates ∗/ 0x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , /∗ Wave 2 FlowStates ∗/ 0x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , /∗ Wave 3 FlowStates ∗/ 0x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , 0 x00 , } ; // END DO NOT EDIT 193 // DO NOT EDIT . . . const char xdata I n i t D a t a [ 7 ] = { /∗ Regs ∗/ 0xC0 , 0 x00 , 0 x00 , 0 x00 , 0 xEE, 0 xE4 , 0 x00 198 } ; // END DO NOT EDIT // TO DO: You may add a d d i t i o n a l code below . 203 void G p i f I n i t ( void ) { BYTE i ; // R e g i s t e r s which r e q u i r e a s y n c h r o n i z a t i o n delay , see s e c t i o n 15.14 208 // FIFORESET FIFOPINPOLAR // INPKTEND OUTPKTEND // EPxBCH: L REVCTL // GPIFTCB3 GPIFTCB2 // GPIFTCB1 GPIFTCB0 213 // EPxFIFOPFH: L EPxAUTOINLENH: L 90 Matthias Zurbrügg, Christoph Zimmermann
E.1. Firmware // EPxFIFOCFG EPxGPIFFLGSEL // PINFLAGSxx EPxFIFOIRQ // EPxFIFOIE GPIFIRQ // GPIFIE GPIFADRH: L 218 // UDMACRCH: L EPxGPIFTRIG // GPIFTRIG 223 // Note : The pre−REVE EPxGPIFTCH/L r e g i s t e r are a f f e c t e d , as w e l l . . . // . . . t h e s e have been r e p l a c e d by GPIFTC[ B3 : B0 ] r e g i s t e r s // 8051 doesn ’ t have a c c e s s to waveform memories ’ t i l // t h e p a r t i s in GPIF mode . IFCONFIG = 0xEE ; 228 // IFCLKSRC=1 , FIFOs e x e c u t e s on i n t e r n a l c l k source // xMHz=1 , 48MHz i n t e r n a l c l k r a t e // IFCLKOE=0 , Don ’ t d r i v e IFCLK pin s i g n a l at 48MHz // IFCLKPOL=0 , Don ’ t i n v e r t IFCLK pin s i g n a l from i n t e r n a l c l k // ASYNC=1 , master samples asynchronous 233 // GSTATE=1 , Drive GPIF s t a t e s out on PORTE[ 2 : 0 ] , debug WF // IFCFG[ 1 : 0 ] = 1 0 , FX2 in GPIF master mode GPIFABORT = 0xFF ; // a b o r t any waveforms pending 238 GPIFREADYCFG = I n i t D a t a [ 0 ] ; GPIFCTLCFG = I n i t D a t a [ 1 ] ; GPIFIDLECS = I n i t D a t a [ 2 ] ; GPIFIDLECTL = I n i t D a t a [ 3 ] ; GPIFWFSELECT = I n i t D a t a [ 5 ] ; 243 GPIFREADYSTAT = I n i t D a t a [ 6 ] ; // use dual a u t o p o i n t e r f e a t u r e . . . AUTOPTRSETUP = 0 x07 ; // inc both p o i n t e r s , // . . . warning : t h i s i n t r o d u c e s pdata h o l e ( s ) 248 // . . . at E67B (XAUTODAT1) and E67C (XAUTODAT2) 253 // source AUTOPTRH1 = MSB( &WaveData ) ; AUTOPTRL1 = LSB( &WaveData ) ; // d e s t i n a t i o n AUTOPTRH2 = 0xE4 ; AUTOPTRL2 = 0 x00 ; 258 // t r a n s f e r for ( i = 0 x00 ; i < 1 2 8 ; i++ ) { EXTAUTODAT2 = EXTAUTODAT1; } 263 // Configure GPIF Address pins , output i n i t i a l value , PORTCCFG = 0xFF ; // [ 7 : 0 ] as a l t . func . GPIFADR[ 7 : 0 ] OEC = 0xFF ; // and as o u t p u t s PORTECFG |= 0 x80 ; // [ 8 ] as a l t . func . GPIFADR[ 8 ] 268 OEE |= 0 x80 ; // and as output // . . .OR. . . t r i −s t a t e GPIFADR[ 8 : 0 ] p i n s // PORTCCFG = 0x00 ; // [ 7 : 0 ] as p o r t I /O // OEC = 0 x00 ; // and as i n p u t s 273 // PORTECFG &= 0x7F ; // [ 8 ] as p o r t I /O // OEE &= 0x7F ; // and as i n p u t // GPIF address p i n s update when GPIFADRH/L w r i t t e n SYNCDELAY; // 278 GPIFADRH = 0 x00 ; // b i t s [ 7 : 1 ] always 0 SYNCDELAY; // Project Report 91
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Gecko3 New generation of the Microl
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Inhaltsverzeichnis Abbildungsverzei
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Inhaltsverzeichnis E.3.3. Simplecom
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ABBILDUNGSVERZEICHNIS D.1. Block Di
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1. Überblick Dieses Kapitel dient
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1.4. Funktionsumfang des Gecko3 Boa
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2. Definition der Diplomarbeit und
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3.2. Entwicklungssoftware Hardware
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3.3. Inbetriebnahme lieferten Beisp
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4.1. Handshake-Protokoll Abbildung
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5. VHDL In diesem Kapitel beschreib
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5.1. Kommunikations Loopback Abbild
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6. Firmware Der EZ-USB FX2 hat nebe
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6.3. Grundstruktur der Firmware Abb
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6.4. FPGA Konfiguration 6.4. FPGA K
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6.5. Stand-alone Betrieb 6.5. Stand
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6.5. Stand-alone Betrieb 6.5.2. EEP
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6.6. FPGA Autokonfiguration Abbildu
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6.7. Kommunikation zwischen Host un
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7. Hostsoftware Der aus Sicht des A
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Literaturverzeichnis [Bre03] Ulrich
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